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DFG-Schwerpunktprogramm „Rekonfigurierbare Rechensysteme“Darmstadt, 01. - 02. Juni 2006ReCoNodes
1
Projekt
Prof. Dr. Sándor Fekete
Dipl.-Math. Jan van der Veen
Prof. Dr.-Ing. Jürgen Teich
Dipl.-Ing. Mateusz MajerDipl.-Ing. Diana GöhringerDipl.-Inf. Josef Angermeier
ReCoNodes –Optimierungsmethodik zur Steuerung
hardwarekonfigurierbarer Knoten
DFG-Schwerpunktprogramm „Rekonfigurierbare Rechensysteme“Darmstadt, 01. - 02. Juni 2006ReCoNodes
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Gliederung
� Motivation und Ziele � Erlangen Slot Machine – Stand der Entwicklungen� Anwendungen
� Videofilter: Partielle Rekonfiguration� Computerspiel PONG: Relokation von Hardware-Modulen
� ReCoLib� ESM User Group� Kooperationen� Publikationen
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Motivation und Ziele
Operating System
Services
task 1
task 2
task N
Reconfigurable HW
PlacerM2
M4
M3
M1
Module Database
Scheduler
Task Request
O.S.
T1
TN
T2
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Motivation und Ziele
� Defizite existierender Plattformen
� I/O-Pin-Dilemma- Auf kommerziell verfügbaren FPGA Plattformen sind die I/O-Pins fest
verdrahtet. Dies verhindert Relokation.
� Intermodulkommunikation- Wie tauschen Module Daten aus, wenn ihre Platzierung zur Compile-
Zeit noch unbekannt ist?
� Werkzeuge für den Entwurf- Viel Erfahrungswissen ist nötig, um frei relozierbare Module zu
erzeugen
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Lösung: Erlangen Slot Machine (ESM)
BabyBoard
MotherBoard
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Stand der ESM
� Entwicklung und Implementierung der ESM-Hardware� Inbetriebnahme und Test der ESM-Plattform
[33] The Erlangen Slot Machine: A Dynamically Reconfigurable FPGA-Based ComputerM. Majer, J. Teich, A. Ahmadinia, C. BobdaJournal of VLSI Signal Processing Systems. (accepted)
[28] Increasing the Flexibility in FPGA-Based Reconfigurable Platforms: The Erlangen Slot MachineC. Bobda, M. Majer, A. Ahmadinia, T. Haller, A. Linarth and J. TeichIn Proceedings of the IEEE Conference on Field-Programmable Technology (FPT), Singapore, pp. 37-42, December 11-14, 2005.
[22] The Erlangen Slot Machine: A Highly Flexible FPGA-Based Reconfigurable PlatformC. Bobda, M. Majer, A. Ahmadinia, T. Haller, A. Linarth, J. Teich, S. Fekete and J. van der VeenIn Proceedings of the IEEE Symposium on Field-Programmable Custom Computing Machines(FCCM), Napa, USA, pp. 319-320, April 17-20, 2005.
DFG-Schwerpunktprogramm „Rekonfigurierbare Rechensysteme“Darmstadt, 01. - 02. Juni 2006ReCoNodes
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Stand der ESM
� Vier ESM-Plattformen werden bereits genutzt
� Funktionsfähige Hardware-Firmware� Babyboard
- XC2V6000 (Haupt-FPGA), CPLD, XC2S400E (Rekonfigurationsmanager)- Flash, SRAM
� Motherboard- XC2S600E (Crossbar), SDRAM- Videoeingang, Videoausgang
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Stand der ESM
� MPC875 PowerPC als Steuerprozessor
� Linux als Betriebssystem integriert� Angepasster 2.6 Kernel� Bootvorgang vom Flash oder über Ethernet� Eigene Treiber für Ethernet und USB
� ESM-Shell zur Verwaltung der ESM� Konfiguration der Crossbar� Kommunikation mit dem XC2V6000 Haupt-FPGA� Kommunikation mit dem Rekonfigurationsmanager
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Videoverarbeitung
� Konfigurieren der Crossbarmittels MPC875 für Videoapplikationen
� Video-Input geht an Haupt-FPGA
� Zwischenpufferung im SRAM
� Änderung des Videosignals mittels dynamisch rekonfigu-rierbarer Filter
� Ausgabe des Videosignals über die Crossbar
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Videofilter: Partielle Rekonfiguration
� Partielle Videofilter� Normal� Grau� Invertierung� Kontrast
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Computerspiel: Relokation
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Computerspiel: Relokation
Racket Position
User Input
Ball Position
Visualization
4
20
20 38
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4
20
20 38
Computerspiel: Relokation
Racket Position
User Input
Ball Position
Visualization
CP
Use
rIn
put
CP
Rac
ket
Pos
ition
CP
Bal
lP
ositi
on
CP
Vis
ualiz
atio
n
Aufgabe:• Platziere die Module so, dass möglichst wenige
parallele Segmente genutzt werdenLösung:
• Ganzzahliges lineares Programm (FPL’06)
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4
20
20 38
Computerspiel: Relokation
Racket Position
User Input
Ball Position
Visualization
CP
Use
rIn
put
CP
Rac
ket
Pos
ition
CP
Bal
lP
ositi
on
CP
Vis
ualiz
atio
n
CP
Use
rIn
put
CP
Bal
lP
ositi
on
CP
Vis
ualiz
atio
n
CP
Rac
ket
Pos
ition
58 parallele Segmente
Aufgabe:• Platziere die Module so, dass möglichst wenige
parallele Segmente genutzt werdenLösung:
• Ganzzahliges lineares Programm (FPL’06)
DFG-Schwerpunktprogramm „Rekonfigurierbare Rechensysteme“Darmstadt, 01. - 02. Juni 2006ReCoNodes
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Computerspiel: Relokation
CP
Use
rIn
put
CP
Bal
lP
ositi
on
CP
Vis
ualiz
atio
n
CP
Rac
ket
Pos
ition
Länge der längsten Verbindung ist 3
58 parallele Segmente
Aufgabe:• Platziere die Module so, dass bei gegebener maximaler
Anzahl paralleler Segmente die Länge der längstenVerbindung minimiert wird
Lösung:• Ganzzahliges lineares Programm (FPL’06)
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Computerspiel: Relokation
CP
Use
rIn
put
CP
Bal
lP
ositi
on
CP
Vis
ualiz
atio
n
CP
Rac
ket
Pos
ition
Länge der längsten Verbindung ist 2
Aufgabe:• Platziere die Module so, dass bei gegebener maximaler
Anzahl paralleler Segmente die Länge der längstenVerbindung minimiert wird
Lösung:• Ganzzahliges lineares Programm (FPL’06)
DFG-Schwerpunktprogramm „Rekonfigurierbare Rechensysteme“Darmstadt, 01. - 02. Juni 2006ReCoNodes
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Computerspiel: Relokation
Länge der längsten Verbindung ist 2
CP
Rac
ket
Pos
ition
CP
Use
rIn
put
CP
Bal
lP
ositi
on
CP
Vis
ualiz
atio
n
DFG-Schwerpunktprogramm „Rekonfigurierbare Rechensysteme“Darmstadt, 01. - 02. Juni 2006ReCoNodes
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Implementierung
CP0 CP2CP1 CP3
RacketPosition
UserInput Display
BallPosition
[32] Minimizing Communication Costs for Reconfigurable Slot ModulesS. Fekete, J. van der Veen, M. Majer, J. TeichIn Proceedings of the International Conference on Field Programmable Logic and Applications (FPL), Madrid, Spain, August 28-30, 2006. (to appear)
[23] A Practical Approach for Circuit Routing on Dynamic Reconfigurable DevicesA. Ahmadinia, C. Bobda, J. Ding, M. Majer, J. Teich, J. van der Veen and S. Fekete,In Proceedings of the IEEE International Workshop on Rapid System Prototyping (RSP), Montreal, Canada, pp. 84-90, June 8-10, 2005.
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Kooperationen
� Prof. Dr. Koch� Optimal Merging of Configurations for Reconfigurable
Architechtures, FPL 2005
� Prof. Dr. Rosenstiel� Optimal Simultaneous Scheduling, Binding and Routing for
Processor-Like Reconfigurable Architectures, FPL 2006
� Optimal algorithms as a benchmark for heuristics
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ReCoLib
� Bibliothek für Reconfigurable Computing
� Sammlung von Modulen (Processing, I/O, Kommunikationsstrukturen, Speicher, OS) für verschiedene Anwendungsgebiete(HPC, Video, Audio, Automotive, Crypto, Consumer)
� Verschiedene Formate (HLL, HDL, RTL, Netlist, Bitstream)
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ESM User Group
� Bereitstellung von ESM-Plattformen für Projekte im SPP
� HW-Firmware und Linux-Port bereits verfügbar� ESM-Einführungskurs in Erlangen im Rahmen eines Mini-
Workshops geplant
� Wir erwarten einen offenen Austausch von � Modulen und Anwendungen mit partieller Rekonfiguration� Modulen zur Inter-Modulkommunikation� Algorithmen zur Steuerung der Modulplatzierung und
-relokation� Firmware-Erweiterungen
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Weitere Kooperationen
� Projekt ReCoNets� Kopplung ReCoNodes (Mikrosicht)
und ReCoNets (Makrosicht)� Platzierungsalgorithmen für die
Hardware-Migration/Morphing� Checkpoints für Relokation
� Dr.-Ing. W. Stechele, Dipl.-Ing. C. Claus� Integration von Videofilterengines auf der ESM-Plattform
(Diplomarbeit)
ReCoNets
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Publikationen[33] The Erlangen Slot Machine: A Dynamically Reconfigurable FPGA-Based Computer
M. Majer, J. Teich, A. Ahmadinia, C. BobdaJournal of VLSI Signal Processing Systems. (accepted)
[32] Minimizing Communication Costs for Reconfigurable Slot ModulesS. Fekete, J. van der Veen, M. Majer, J. TeichIn Proceedings of the International Conference on Field Programmable Logic and Applications (FPL), Madrid, Spain, August 28-30, 2006. (to appear)
[31] Optimal Simultaneous Scheduling, Binding and Routing for Processor-Like ReconfigurableArchitecturesJ. Brenner, J. van der Veen, S.Fekete, J. Oliveira Filho, W. RosenstielIn Proceedings of the International Conference on Field Programmable Logic and Applications (FPL), Madrid, Spain, August 28-30, 2006. (to appear)
[30] An FPGA-Based Dynamically Reconfigurable Platform: from Concept to RealizationM. MajerIn Proceedings of the International Conference on Field Programmable Logic and Applications (FPL), Madrid, Spain, August 28-30, 2006. (to appear)
[29] A Flexible Reconfiguration Manager for the Erlangen Slot MaschineM. Majer, A. Ahmadinia, C. Bobda, and J. TeichIn Proceedings of the Dynamically Reconfigurable Systems Workshop (DRS), Frankfurt/Main, Germany, pp. 183-194, March 16, 2006.
[28] Increasing the Flexibility in FPGA-Based Reconfigurable Platforms: The Erlangen Slot MachineC. Bobda, M. Majer, A. Ahmadinia, T. Haller, A. Linarth and J. TeichIn Proceedings of the IEEE Conference on Field-Programmable Technology (FPT), Singapore, pp. 37-42, December 11-14, 2005.
DFG-Schwerpunktprogramm „Rekonfigurierbare Rechensysteme“Darmstadt, 01. - 02. Juni 2006ReCoNodes
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Publikationen[27] Modular Video Streaming on a Reconfigurable Platform
C. Bobda, A. Ahmadinia, M. Majer, J. Ding and J. TeichIn Proceedings of the IFIP International Conference on Large Scale Integration (VLSI-SOC), Perth, Australia, pp. 103-108, October 17-19, 2005.
[26] DyNoC: A Dynamic Infrastructure for Communication in Dynamically Reconfigurable DevicesA. Ahmadinia, C. Bobda, M. Majer, J. Teich, S. Fekete and J. van der VeenIn Proceedings of the International Conference on Field-Programmable Logic and Applications (FPL), Tampere, Finland, pp. 153-158, August 24-26, 2005.
[25] Optimal Merging of Configurations for Reconfigurable ArchitecturesN. Kasprzyk, J. van der Veen, A. KochIn Proceedings of the International Conference on Field-Programmable Logic and Applications (FPL), Tampere, Finland, pp. 153-158, August 24-26, 2005.
[24] Defragmenting the Module Layout of a Partially Reconfigurable DeviceJ. van der Veen, S. Fekete, M. Majer, A. Ahmadinia, C. Bobda, F. Hannig and J. TeichIn Proceedings of the International Conference on Engineering of Reconfigurable Systems and Algorithms (ERSA), Las Vegas, USA, pp. 92-101, June 27-30, 2005.
[23] A Practical Approach for Circuit Routing on Dynamic Reconfigurable DevicesA. Ahmadinia, C. Bobda, J. Ding, M. Majer, J. Teich, J. van der Veen and S. Fekete,In Proceedings of the IEEE International Workshop on Rapid System Prototyping (RSP), Montreal, Canada, pp. 84-90, June 8-10, 2005.
[22] The Erlangen Slot Machine: A Highly Flexible FPGA-Based Reconfigurable PlatformC. Bobda, M. Majer, A. Ahmadinia, T. Haller, A. Linarth, J. Teich, S. Fekete and J. van der VeenIn Proceedings of the IEEE Symposium on Field-Programmable Custom Computing Machines (FCCM), Napa, USA, pp. 319-320, April 17-20, 2005.
DFG-Schwerpunktprogramm „Rekonfigurierbare Rechensysteme“Darmstadt, 01. - 02. Juni 2006ReCoNodes
Vielen Dank für Ihre Aufmerksamkeit
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ReCoNodes
Mateusz Majer
Hardware-Software-Co-Design
Universität Erlangen-Nürnberg